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D类音频系统中斩波运放电路的设计

作者:admin 发布时间:2019-06-11 11:24

  在D类音频放大器的运放电路设计中,信号的低谐波失真(TotalHarmonicdistortion)和噪声对运放的设计构成应战。关于20~20KHz范围的音频信号而言,运放的失真主要是由电压失调和低频1/f噪声惹起的。而CMOS工艺相对较高的1/f噪声和电压失调,使得这一问题尤为严重。当请求电路的失调电压低于1mV且输入等效噪声低于100nV/Hz时。普通的CMOS运放很难满足需求。而常见的静态失调消零技术,如trimming修调,固然能很好地消弭电压失调的影响,但是却不能降低1/f噪声。处理这个问题的最好办法就是采用动态消零技术(dynamicoffset—cancellationtechniques),如自动稳零和斩波技术。自动稳零技术(Autozerotiechnique)是经过对低频噪声和失调停止采样,然后在运算放大器的输入或输出端将它们从信号的霎时值中减去,完成对失调和噪声的降低。由于自动稳零技术运用的是电容采样的原理,因而在电路工作中极易将宽带热噪声折叠到基带频率内,并且运放的带宽越宽,采样电容上的噪声也越多,通常高达70nV/Hz。斩波技术(ChopperTechnique)是采用调制和解调原理,将低频噪声和失调搬移到高频局部,运用低通滤波滤除,由于没有热噪声的混叠,因而运放的噪声电压比自动稳零技术的更低。但是斩波开关电荷注入和电荷馈通效应的影响,依然能够产生100uV左右的剩余电压失调(residualoffset)。而且斩波开关的运用,器件的热噪声电平将会有所增加。
  为此,本文在0.35微米N阱工艺的根底上,设计了单电源供电的全差分斩波运放电路,同时,为了减小剩余电压的失调,采用了T/H(跟踪-坚持)解调技术,该电路在斩波频率150KHz工作时,输入等效噪声到达31.12nV/Hz。
D类音频系统中斩波运放电路的设计
  2斩波运放的工作原理
  斩波运放的原理如图1所示,其中Vin是输入音频信号,被频率为fch,幅度为1的斩波开关调制,依据奈奎斯特采样原理,为了防止信输入信号的混叠,fch必需远大于2倍的信号带宽。
  经过调制后,信号的被搬移到斩波方波的奇次谐波频率上。此信号被增益为Av的运算放大器放大,同时运放的输入噪声和输入失调电压也被运放放大,运放的输出经过幅度为1,频率为fch的斩波开关调制后,输出信号为:
  公式
  从式(1)能够看出,经过第2次斩波后,输入音频信号被解调到低频段,而运放的电压失调和低频噪声只经过一次调制后被搬移到斩波方波的高频奇次谐波上,经过低通滤波后,输出信号中的高频重量被滤除,低频重量复原为音频信号,从而完成了对音频信号的准确放大。
  对输出信号停止傅立叶剖析,得到运放的最终输入噪声谱密度(PSD)为:
  公式
  其中系数K与工艺的噪声参数有关。
  3运放电路的设计
  本文设计的斩渡放大器为CMOS全差分电路构造。由斩波开关、主运放电路、输出级和共模反应电路四局部组成。电路的工作电压范围2.5V~5.5V。斩波运算放大器的电路构造如图2所示。
  斩波运放的电路构造
  图2斩波运放的电路构造
  输入斩波开关完成对音频信号的调制造用,斩波开关在时钟上沿和下沿都会引入剩余电压失调,图3为零输入时剩余失调电压的波形。
  T/H解调及控制时序
  经过对CMOS开关特性剖析能够得出等效输入剩余失调电压为Vos,rmts=2Vspiketfch,其中t是MOS开关的时间常数,从此式能够看出消弭剩余电压失调有三种办法:
  1.降低斩波频率:
  2.减小输入电阻;
  3.减小斩波开关的电荷注入效应。
  由于MOS管1/f噪声的拐角频率普通都在几十KHz以上,减小斩波频率不能很好地对1/f噪声停止调制,而输入电阻只与信号源内阻有关,在设计中很难将输入电阻降低,因而只能思索减小开关的电荷注入效应。为此输入斩波开关采用互补时钟构造,在尺寸上运用最小线宽,一方面可以减小传输的导通电阻,提供较大的电压摆幅;另一方面减小了电荷注入和馈通的影响,降低了剩余电压失调。思索到PMOS管比NMOS管的1/f噪声特性好,所以输入管MP1和MP2采用大面积的PMOS管,既能减小因器件的失配惹起的电压失调,又能够降低晶体管1/f噪声的拐角频率,改善运放的噪声特性。
  为了更小地降低剩余电压失调,fold—cascode运放的输出采用T/H解调技术,电路构造和时序如图4。该电路的工作原理:在跟踪信号时K1~K4闭合,K5~K8断开,输出信号坚持在电容C1和C2上,当电路输出时,K1~K4断开,K5~K8闭合,C1和C2的电压值加载到负载电容C3上求和。由于C2上的电压叠加到负载电容时经过了反向,因而放大器的剩余电压失调可以有效地抵消。由于解调器采用高阻结点斩波。因而能够运用较小面积的NMOS管开关,减小对输出极点的影响。
  主运放采用全差分折叠式cascode构造,在Class-D的构造中,由于输出功率MOSFET大电流的频繁开启,产生的电磁干扰(EMI)会在电源上构成很强的纹波,在实践应用中发现当芯片工作在5V的电源电压下,EMI惹起的电源动摇能到达±2V,全差分构造既能够进步运放的电源抑止比和共模抑止比,削弱电源噪声和共模噪声的影响,而且防止了镜像极点,因此关于更大的带宽仍能表现出稳定的特性。
  为了提供更高的增益和电压输出摆幅,在fold-cascode后参加共源运放输出级。采用二级运放后.对运放的频率稳定性停止剖析。暂时不思索斩波开关的影响,能够推断该电路至少有三个LHP极点,它们分别是miller补偿电容引入的主极点Wp1,输出滤波电容产生的输出极点Wpout。为第一非主极点,以及folded-cascode(MN1的漏端、MN3的源端)引入的非极点Wp3,三者之间的关系为Wp1<wpout<wp3。另外从电路能够看出,在共源输出级产生了一个低频的rhp零点,经过引入miller补偿电阻将此零点从右半平面挪动到左半平面并抵消第二极点。为了进一步减小高频干扰,系统输出级经过电容接地,滤除高频信号。<p=""></wpout<wp3。另外从电路能够看出,在共源输出级产生了一个低频的rhp零点,经过引入miller补偿电阻将此零点从右半平面挪动到左半平面并抵消第二极点。为了进一步减小高频干扰,系统输出级经过电容接地,滤除高频信号。<>
  共模反应电路由MN7~MN10、MP10-MP12构成,输入一端接VDD/2的基准电压,另一端接主运放的共模输出,共模检测电路由电阻和电容构成.经过误差放大后调控主运放的偏置电流。
  4仿真结果及幅员设计
  在SMICO.35微米N阱工艺下.应用cadencespectre工具对本文所设计的电路停止了仿真剖析。其中,各器件的工艺参数为典型状况,电源电压5V,输入信号为幅度10uV,频率为1KHz的规范正弦波,斩波频率fch=150K,仿真波形如图5和图6所示。
  能够看出,在典型状况下,该运放的主极点在10HZ以内,相位裕度75度左右.能充沛保证运放在各个comer条件下的稳定性。从输fn波形来看,斩波惹起的剩余电压尖峰也有了明显的改善。表1为运放的开环仿真结果。
  该电路的幅员采用SMIC0.35um工艺规则设计并对幅员停止优化,衬底接地采用全封锁的doublegardring,有效降低了衬底的耦合噪声,差分对采用哑栅共质心匹配降低输入电压失调。另外,为了减小外围电路对运放的干扰,将后后级的滤波电容分散在运放电路的四周,优化后的幅员面积为0.24mmx0.34mm,概貌如图7。
  幅员规划
  D类音频功放的1/f噪声和电压失调对信号的失真和噪声性能产生直接的影响,特别是在输入信号为零时的背景噪声最为明显,经过采用全差分斩波运放电路和T/H解调技术,有效地降低了系统的低频噪声和电压火调。流片后的对芯片的测试标明,该电路使Class-D的噪声性能有了很大的改善。
  本文作者创新点:采用全差分斩波运放电路和T/H解调技术,有效地降低了D类音频系统的低频噪声和电压失调。
  项目经济效益:本项目已流片胜利,依据ForwardConceptslnc数据显现2008年全球D类音频功放的总产值高达8亿美金。